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[공학] [VHDL] Digital stop watch[디지털 스톱 워치] 설계 소스 - 키트와 쿼터스를 이용

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작성일 20-11-11 21:10

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2. 설계 일정
설계 구조
소스 data(資料) 검색
코딩
시뮬레이션 analysis
보고서 작성

3. 수행 내용

▼ 프로젝트 intro

- 키트의 Segment에 시간을 Display하고, Button switch로 control
- 시간, 분, 1/100초 단위까지 있어서 세밀하게 시간을 측정(測定) 할 수 있다

▼ 사용된 툴과 키트 intro

- 사용 툴 : Quartus2
- 키트 : HBE-COMBO2[FPGA] ` Cyclone2 (EP2C35F672C8N)

▼ the gist 알고리즘과 간략한 구조 intro

- 4개의 주요 회로를 컴포넌트 문으로 결합하여 사용

▼ 구현된 프로그램(program]) 소스 intro

Entity 입출력 포트 선언

entity stopwatch is
port( clk : in std_logic; 1kHz
reset : in std_logic;
start_stop : in std_logic; Run/Stop 동작을 조정하는 스위치
p0 : out std_logic;
p1 : out std_logic;
p2 : out std_logic;
p3 : out std_logic;
p4 : out std_logic;
p5 : out std_logic; com0 ~ com5, 6개의 Segment만 사용
a : out std_logic;
b :…(투비컨티뉴드 )

순서

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설명

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Digital Stop Watch

1. 수행 목적

Digital Stop Watch는 정확하게 시간을 멈출 수 있고, 시간을 숫자로 표시해 주기 때문에 보기 쉬운 장점(長點)이 있어 Analog에 비해 활용도가 높고 Digital 시계가 익숙한 현 세대에 더욱 선호되는 편이다. 이번 프로젝트 설계를 통해 학기 동안 배웠던 VHDL 문법을 복습하고, 나아가 더 복잡한 구조를 해석하고 설계할 수 있는 능력을 기를 수 있으며 키트의 세그먼트 활용과 클락 신호를 다루는 능력을 기를 수 있을 것이다.
2. 설계 일정
설계 구조
소스 data(資料) 검색
코딩
시뮬레이션 analysis
보고서 작성

3. 수행 내용

▼ 프로젝트 intro

- 키트의 Segment에 시간을 Display하고, Button switch로 control
- 시간, 분, 1/100초 단위까지 있어서 세밀하게 시간을 측정(測定) 할 수 있다

▼ 사용된 툴과 키트 intro

- 사용 툴 : Quartus2
-...

Digital Stop Watch

1. 수행 목적

Digital Stop Watch는 정확하게 시간을 멈출 수 있고, 시간을 숫자로 표시해 주기 때문에 보기 쉬운 장점(長點)이 있어 Analog에 비해 활용도가 높고 Digital 시계가 익숙한 현 세대에 더욱 선호되는 편이다. 이번 프로젝트 설계를 통해 학기 동안 배웠던 VHDL 문법을 복습하고, 나아가 더 복잡한 구조를 해석하고 설계할 수 있는 능력을 기를 수 있으며 키트의 세그먼트 활용과 클락 신호를 다루는 능력을 기를 수 있을 것이다.

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18016	더 좋아진 입안벌리고자기 물건 인거같아요 맘에드네요.
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18003	, 이건 사야합니다 수입리본